STATIC WORDLINE REDUNDANCY MEMORY DEVICE
The invention relates to a memory device comprising a set of word decoders (W), a set of wordline drivers (WL), a plurality of switches (S) to connect a subset of the wordline drivers to the set of word decoders and storage means (5) for storage of information indicative of defective wordline, the w...
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Format | Patent |
Language | English French |
Published |
19.12.1996
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Edition | 6 |
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Summary: | The invention relates to a memory device comprising a set of word decoders (W), a set of wordline drivers (WL), a plurality of switches (S) to connect a subset of the wordline drivers to the set of word decoders and storage means (5) for storage of information indicative of defective wordline, the wordline drivers comprising a predefined first subset of wordline drivers which are to be used when no wordline is defective, the set of wordline drivers further comprising a plurality of second subsets of wordline drivers which are to be used when one of the wordlines is defective, the memory device further comprising logic means (4) for logically and permanently assigning one of the subsets to the set of word decoders in response to the information stored in the storage means, the logic means (4) controlling the switches (S) to connect the second subset of wordline drivers to the set of word decoders.
La présente invention se rapporte à un dispositif de mémoire composé d'un ensemble de décodeurs de mots (W), d'un ensemble de circuits de commande de lignes de mots (WL), d'une pluralité de commutateurs (S) permettant de connecter un sous-ensemble de circuits de commande de lignes de mots à l'ensemble des décodeurs de mots ainsi que des dispositifs de stockage (5) permettant de stocker les informations indiquant une ligne de mots défectueuse. Les circuits de commande de lignes de mots comportent un premier sous-ensemble prédéfini de circuits de commande de lignes de mots qui sont utilisés lorsqu'il n'existe pas de ligne de mots défectueuse. De plus, l'ensemble de circuits de commande de lignes de mots comprend une pluralité de seconds sous-ensembles de circuits de commande delignes de mots qui sont utilisés lorsqu'une des lignes de mots est défectueuse. En outre, le dispositif de mémoire comprend un dispositif logique (4) qui affecte de manière logique et permanente l'un des sous-ensembles à l'ensemble des décodeurs de mots en réponse aux informations stockées dans le dispositif de stockage; cedispositif logique (4) commande les commutateurs (S) afin de connecter le second sous-ensemble de circuits de commande de lignes de mots à l'ensemble des décodeurs de mots. |
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Bibliography: | Application Number: WO1995EP02183 |