OUTPUT CIRCUIT
An output circuit (1) outputs an output signal (Z) having an amplitude VCCH corresponding to an input signal (IN) having an amplitude VCCL. The output circuit (1) comprises: transistors (P11, P12) connected in series between VCCH and an output terminal (Z); a transistor (N21) in which a source is gr...
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Format | Patent |
Language | English French Japanese |
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20.04.2023
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Summary: | An output circuit (1) outputs an output signal (Z) having an amplitude VCCH corresponding to an input signal (IN) having an amplitude VCCL. The output circuit (1) comprises: transistors (P11, P12) connected in series between VCCH and an output terminal (Z); a transistor (N21) in which a source is grounded and a gate receives a first signal (NL); a transistor (P21) in which a source is connected to VCCH, a drain is connected to a gate of the transistor (P11) and a gate receives a second signal (NH); and a diode (D11) connected between drains of the transistors (N21, P21).
La présente divulgation concerne un circuit de sortie (1) qui délivre un signal de sortie (Z) ayant une amplitude VCCH correspondant à un signal d'entrée (IN) ayant une amplitude VCCL. Le circuit de sortie (1) comprend : des transistors (P11, P12) connectés en série entre le VCCH et une borne de sortie (Z) ; un transistor (N21) dans lequel une source est mise à la terre et une grille reçoit un premier signal (NL) ; un transistor (P21) dans lequel une source est connectée au VCCH, un drain est connecté à une grille du transistor (P11) et une grille reçoit un deuxième signal (NH) ; et une diode (D11) connectée entre des drains des transistors (N21, P21).
出力回路(1)は、振幅VCCLの入力信号(IN)に応じた振幅VCCHの出力信号(Z)を出力する。出力回路(1)は、VCCHと出力端子(Z)との間に直列に接続されたトランジスタ(P11,P12)と、ソースが接地され、ゲートに第1信号(NL)を受けるトランジスタ(N21)と、ソースがVCCHに接続され、ドレインがトランジスタ(P11)のゲートに接続され、ゲートに第2信号(NH)を受けるトランジスタ(P21)と、トランジスタ(N21,P21)のドレイン同士の間に接続されたダイオード(D11)とを備える。 |
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Bibliography: | Application Number: WO2021JP37842 |