하드웨어 검증을 위한 런타임 ECC 에러 주입 체계

하드웨어 검증을 위한 런타임 에러 정정 코드("ECC") 에러 주입 체계를 위한 시스템들 및 방법들이 개시된다. 본 시스템들 및 방법들은, 판독 데이터를 내부적으로 포워딩하도록 판독 경로를 구성하는 것과 그리고 판독 결함 주입 로직을 통해 적어도 하나의 결함 비트를 포워딩된 판독 데이터에 주입하는 것을 포함한다. 시스템들 및 방법들은 또한, 기록 데이터를 내부적으로 포워딩하도록 기록 경로를 구성하는 것과 그리고 기록 결함 주입 로직를 통해 적어도 하나의 결함 비트를 포워딩된 기록 데이터에 주입하는 것을 포함할 수...

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Main Authors RANGARAJAN SANKAR, CATHERWOOD MICHAEL, IVEY BRANT
Format Patent
LanguageKorean
Published 06.12.2017
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Summary:하드웨어 검증을 위한 런타임 에러 정정 코드("ECC") 에러 주입 체계를 위한 시스템들 및 방법들이 개시된다. 본 시스템들 및 방법들은, 판독 데이터를 내부적으로 포워딩하도록 판독 경로를 구성하는 것과 그리고 판독 결함 주입 로직을 통해 적어도 하나의 결함 비트를 포워딩된 판독 데이터에 주입하는 것을 포함한다. 시스템들 및 방법들은 또한, 기록 데이터를 내부적으로 포워딩하도록 기록 경로를 구성하는 것과 그리고 기록 결함 주입 로직를 통해 적어도 하나의 결함 비트를 포워딩된 기록 데이터에 주입하는 것을 포함할 수 있다. Systems and methods for a run-time error correction code ("ECC") error injection scheme for hardware validation are disclosed. The systems and methods include configuring a read path to internally forward read data, and injecting at least one faulty bit into the forwarded read data via a read fault injection logic. The systems and methods may also include configuring a write path to internally forward write data, and injecting at least one faulty bit into the forwarded write data via a write fault injection logic.
Bibliography:Application Number: KR20177025981