POWER STATE COVERAGE METRIC AND METHOD FOR ESTIMATING THE SAME
Embodiments of the present invention provide a method for estimating an entire power state coverage of an electronic system level (ESL) model performed by at least one processor. According to the method, a first value and a second value are set to each block. At least one verification case is select...
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Format | Patent |
Language | English Korean |
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13.04.2017
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Summary: | Embodiments of the present invention provide a method for estimating an entire power state coverage of an electronic system level (ESL) model performed by at least one processor. According to the method, a first value and a second value are set to each block. At least one verification case is selected with respect to each block of the ESL module. With respect to each of at least one verification case, (a) a target coverage value is set, (b) resister transfer level ( RTL) simulation is performed, (c) an actual coverage value is received, and (d) a first value or a second value are updated based on whether the actual coverage value is less than a target coverage value. A power state coverage is calculated with respect to each block. An entire power state coverage is calculated with respect to the ESL model.
일부 실시예들에서, 적어도 하나의 프로세서에 의해 수행되는 전자 시스템 레벨(ESL) 모델의 전체 전력 상태 커버리지를 추정하기 위한 방법에 있어서, 제 1 값 및 제 2 값이 각각의 블록에 대해 설정된다. 적어도 하나의 검증 케이스가 ESL 모델에 있는 각각의 블록에 대해 선택된다. 적어도 하나의 검증 케이스 각각에 대해, (a) 타겟 커버리지 값이 설정되고, (b) 레지스터 전송 레벨(RTL) 시뮬레이션이 수행되고, (c) 실제 커버리지 값이 수신되고, (d) 실제 커버리지 값이 타겟 커버리지 값 미만인지의 여부에 기초하여 제 1 값 또는 제 2 값이 업데이트된다. 전력 상태 커버리지가 각각의 블록에 대해 계산된다. 전체 전력 상태 커버리지가 ESL 모델에 대해 계산된다. |
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Bibliography: | Application Number: KR20160001073 |