REDUCING FLOATING NODE LEAKAGE CURRENT WITH A FEEDBACK TRANSISTOR

본 개시물은, 부동 노드들을 방전시키는 임계치 이하 누설 전류들을 감소시키기 위한 회로들 및 방법들이 제공된다. 일 양상에서, 부동 노드로부터의 피드백은, 턴오프된 트랜지스터들을 통한 누설이 감소되도록, 다른 노드들을 바이어싱하도록 구성된 피드백 트랜지스터에 제공된다. 부가적으로, 정적 전력 소모에 기여하는 누설 또한 감소될 수 있다. This disclosure provides circuits and methods for reducing sub-threshold leakage currents discharging floating...

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Main Authors HONG JOHN HYUNCHUL, RYU SEUNG TAK, KIM CHEONHONG
Format Patent
LanguageEnglish
Korean
Published 15.02.2016
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Summary:본 개시물은, 부동 노드들을 방전시키는 임계치 이하 누설 전류들을 감소시키기 위한 회로들 및 방법들이 제공된다. 일 양상에서, 부동 노드로부터의 피드백은, 턴오프된 트랜지스터들을 통한 누설이 감소되도록, 다른 노드들을 바이어싱하도록 구성된 피드백 트랜지스터에 제공된다. 부가적으로, 정적 전력 소모에 기여하는 누설 또한 감소될 수 있다. This disclosure provides circuits and methods for reducing sub-threshold leakage currents discharging floating nodes. In one aspect, feedback from a floating node is provided to a feedback transistor configured to bias other nodes such that leakage through turned-off transistors is reduced. Additionally, leakage contributing to static power consumption may also be reduced.
Bibliography:Application Number: KR20157037176