A DATA PROCESSING APPARATUS AND METHOD FOR CONTROLLING PERFORMANCE OF SPECULATIVE VECTOR OPERATIONS

데이터 처리장치와 추론 벡터 연산의 수행을 제어하는 방법이 제공된다. 이 장치는, 복수의 벡터 성분들을 각각 포함하는 벡터 피연산자들에 대해 추론 벡터 연산들의 시퀀스를 행하는 처리회로와, 추론 벡터 연산들을 겪을 각각의 벡터 피연산자의 벡터 성분들의 수를 표시하는 추론 폭 표시를 유지하는 추론 제어회로를 구비한다. 추론 폭 표시는 추론 벡터 연산들의 시퀀스의 수행 이전에 초기값으로 설정된다. 처리회로는 추론 벡터 연산들의 시퀀스의 수행중에 진행 표시들을 발생하고, 추론 제어회로는, 진행 표시들과 추론 축소 기준을 참조하여 추론 축...

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Main Authors KERSHAW DANIEL, REID ALASTAIR DAVID
Format Patent
LanguageEnglish
Korean
Published 08.06.2016
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Abstract 데이터 처리장치와 추론 벡터 연산의 수행을 제어하는 방법이 제공된다. 이 장치는, 복수의 벡터 성분들을 각각 포함하는 벡터 피연산자들에 대해 추론 벡터 연산들의 시퀀스를 행하는 처리회로와, 추론 벡터 연산들을 겪을 각각의 벡터 피연산자의 벡터 성분들의 수를 표시하는 추론 폭 표시를 유지하는 추론 제어회로를 구비한다. 추론 폭 표시는 추론 벡터 연산들의 시퀀스의 수행 이전에 초기값으로 설정된다. 처리회로는 추론 벡터 연산들의 시퀀스의 수행중에 진행 표시들을 발생하고, 추론 제어회로는, 진행 표시들과 추론 축소 기준을 참조하여 추론 축소 상태의 존재를 검출한다. 추론 축소 상태는, 추론 폭 표시의 축소가 추론 폭 표시의 축소가 없는 연속된 연산에 대해 데이터 처리장치의 적어도 한 개의 성능 특성을 향상시킬 것으로 예측된다는 것을 표시하는 상태이다. 추론 제어회로는 추론 축소 상태의 검출에 응답하여 추론 폭 표시를 축소시킨다. 이와 같은 구성은 추론 벡터 연산을 수행할 때 (예를 들어 스루풋 및/또는 에너지 소비 면에서) 성능을 증가시킨다. A data processing apparatus and a method of controlling performance of speculative vector operations are provided. The apparatus comprises processing circuitry for performing a sequence of speculative vector operations on vector operands, each vector operand comprising a plurality of vector elements, and speculation control circuitry for maintaining a speculation width indication indicating the number of vector elements of each vector operand to be subjected to the speculative vector operations. The speculation width indication is set to an initial value prior to performance of the sequence of speculative vector operations. The processing circuitry generates progress indications during performance of the sequence of speculative vector operations, and the speculation control circuitry detects, with reference to the progress indications and speculation reduction criteria, presence of a speculation reduction condition. The speculation reduction condition is a condition indicating that a reduction in the speculation width indication is expected to improve at least one performance characteristic of the data processing apparatus relative to continued operation without the reduction in the speculation width indication. The speculation control circuitry is responsive to detection of the speculation reduction condition to reduce the speculation width indication. This can significantly increase performance (for example in terms of throughput and/or energy consumption) when performing speculative vector operations.
AbstractList 데이터 처리장치와 추론 벡터 연산의 수행을 제어하는 방법이 제공된다. 이 장치는, 복수의 벡터 성분들을 각각 포함하는 벡터 피연산자들에 대해 추론 벡터 연산들의 시퀀스를 행하는 처리회로와, 추론 벡터 연산들을 겪을 각각의 벡터 피연산자의 벡터 성분들의 수를 표시하는 추론 폭 표시를 유지하는 추론 제어회로를 구비한다. 추론 폭 표시는 추론 벡터 연산들의 시퀀스의 수행 이전에 초기값으로 설정된다. 처리회로는 추론 벡터 연산들의 시퀀스의 수행중에 진행 표시들을 발생하고, 추론 제어회로는, 진행 표시들과 추론 축소 기준을 참조하여 추론 축소 상태의 존재를 검출한다. 추론 축소 상태는, 추론 폭 표시의 축소가 추론 폭 표시의 축소가 없는 연속된 연산에 대해 데이터 처리장치의 적어도 한 개의 성능 특성을 향상시킬 것으로 예측된다는 것을 표시하는 상태이다. 추론 제어회로는 추론 축소 상태의 검출에 응답하여 추론 폭 표시를 축소시킨다. 이와 같은 구성은 추론 벡터 연산을 수행할 때 (예를 들어 스루풋 및/또는 에너지 소비 면에서) 성능을 증가시킨다. A data processing apparatus and a method of controlling performance of speculative vector operations are provided. The apparatus comprises processing circuitry for performing a sequence of speculative vector operations on vector operands, each vector operand comprising a plurality of vector elements, and speculation control circuitry for maintaining a speculation width indication indicating the number of vector elements of each vector operand to be subjected to the speculative vector operations. The speculation width indication is set to an initial value prior to performance of the sequence of speculative vector operations. The processing circuitry generates progress indications during performance of the sequence of speculative vector operations, and the speculation control circuitry detects, with reference to the progress indications and speculation reduction criteria, presence of a speculation reduction condition. The speculation reduction condition is a condition indicating that a reduction in the speculation width indication is expected to improve at least one performance characteristic of the data processing apparatus relative to continued operation without the reduction in the speculation width indication. The speculation control circuitry is responsive to detection of the speculation reduction condition to reduce the speculation width indication. This can significantly increase performance (for example in terms of throughput and/or energy consumption) when performing speculative vector operations.
Author KERSHAW DANIEL
REID ALASTAIR DAVID
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